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研發工具

首頁  >  研發工具  >  V流程詳細設計驗證階段  >  SLX-FPGA — 高層級FPGA開發工具

SLX-FPGA — 高層級FPGA開發工具

       Silexica公司致力于提供縮短創新型軟件IP及智能產品研發周期的解決方案。其SLX FPGA工具基于深層次的軟件分析,對異構硬件進行充分考慮,從而實現快速的設計空間探索。該工具能夠加速軟件向專用硬件系統的轉化過程,使得算法加速更加普及。

 

 

產品介紹
       SLX FPGA能夠幫助用戶更容易、更快、更高效地將C/C++代碼轉換成RTL代碼。
       SLX FPGA工具可以解決高層次綜合設計流程帶來的各種問題,包括處理不可綜合或未考慮硬件實現的C/C++代碼,檢測應用程序并行性,以及自動插入pragma代碼,以幫助工程師更好地準備及優化待進行高層次綜合的C/C++應用程序。

 

 

• 降低HLS工具使用門檻
       開發人員要熟練使用HLS工具,需要閱讀上千頁的文檔,并熟練掌握相關代碼規范。
       SLX工具能夠幫助用戶:
    ♦  快速識別不可綜合的代碼;
    ♦  為常見的C庫進行自動代碼重構;
    ♦  提供示例來幫助用戶實現可綜合代碼編寫。
       以上功能有效的降低HLS工具使用門檻,使用戶能夠方便的通過C/C++進行FPGA的開發。

 

• 并行性檢測
       C/C++代碼通常是在標準處理器上順序執行的。但是在專用硬件中,部分代碼模塊可以并行地執行,以加速代碼的執行效率。
       如果只是簡單地通過HLS進行代碼轉換,其設計結果也是順序執行的硬件,無法有效的利用硬件并行處理的優勢。

       如果要實現硬件層面的并行執行,需要用戶根據實際情況進行代碼的約束,這對于軟件設計工程師而言會是一個很大的挑戰。
       針對這一挑戰,SLX FPGA提供了C/C++代碼的分析和檢測功能。
       SLX FPGA工具能夠根據代碼的分析和檢測結果,自動進行代碼的并行化約束,讓用戶輕松實現代碼的并行化。

 

• 硬件優化
       SLX FPGA能夠根據用戶的相關配置,自動對識別出的可并行函數進行分析,使用Silexica的專有算法確定當前設計優化的效果。

 

 

• pragma插入

 

 

       一旦確定了優化的硬件實現,SLX-FPGA將自動插入HLS pragma,以指導HLS編譯器對代碼的具體硬件實現細節。
       用戶可直接獲取優化后代碼所生成的IP,將其放入自己的工程中進行使用。

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